流水线续
记录几条信号
regrt 选择 rt 还是 rd
rn 记录选择的结果
然后 drn->mrn->ern->一路传下去
时钟
.mb(readdata) 是从数据存储器中读出来的数据
.malu(aluout)计算出读存储器的地址
readdata->wmo
wdi选择写寄存器的数据，是来自alu的运算呢？ 还是来自读数据存储器的结果
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终于在发现自己少加了一条指令之后。。。
addi这三条指令算是通过了
然后
add
and
or
这三条指令的流水都完成了
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可以看到
sw存数据并没有什么乱用
Memwrite信号一直为z
ok成功地写入了
2
3
测试序列如下
在bne指令取值， 正在译码的时候， 其后的一条指令已经开始取值了
并且这条指令还成功地完成了。
果然书上的是使用了延迟槽来解决的控制相关的
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从测试的这张图上来看
似乎也没有问题
最后的仿真成功了