i2c slave 模块设计
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简介
首先就不啰嗦iic协议了，网上有不少资料都是叙述此协议的。
下面将是我本次设计的一些局部设计汇总，如果对读者有借鉴意义那最好，如果没有的话也无所谓，互相交流而已。（这是我早期的版本，注释比较少，代码编写比较混乱，读者自便）
希望读者发现问题可在下方留言，我会及时回答或者修改。
下面将会以图片为主。
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结构图
iic_slave.v
sync.v
wr_fsm.v
ram.v
必看
此设计还存在一些问题，后续有时间我会完善的。
在同步的时候我建议还是使用两个寄存器缓冲，而不是使用一个，使用多个更加的稳妥一些，我这个就是使用了较少的寄存器缓冲，所以波形中有瑕疵。（我把这段字打个红色背景）。
如果对读者你有帮助请点赞，投币（如果有这个窗口的话“滑稽脸”）收藏，一键三连。（此处恶搞）
本次总结结束。详细iic协议资料会随后总结。
https://blog.****.net/weixin_46163885/article/details/107170689